產(chǎn)品詳情
ICS 三重 T8310
T8310處理器是一種基于三模塊冗余的容錯設(shè)計（TMR）在鎖步配置中運(yùn)行的體系結(jié)構(gòu)。圖1以簡化的形式顯示術(shù)語，可信TMR處理器模塊的基本結(jié)構(gòu)。該模塊包含三個處理器故障控制區(qū)域（FCR），每個區(qū)域包含一個摩托羅拉Power PC系列處理器及其相關(guān)存儲器（EPROM、DRAM、閃存ROM、內(nèi)存映射I/O、表決器和粘合邏輯電路。每個處理器FCR都有對另兩個處理器的FCR內(nèi)存進(jìn)行三分之二（2oo3）的讀取訪問消除發(fā)散操作的系統(tǒng)。模塊的三個處理器存儲并執(zhí)行應(yīng)用程序、掃描和更新輸入/輸出模塊并檢測系統(tǒng)故障。每個處理器執(zhí)行應(yīng)用程序獨(dú)立，但與其他兩個同步。應(yīng)該是
處理器發(fā)散，其他機(jī)制允許出現(xiàn)故障的處理器與另外兩個。
T8310每個處理器都有一個接口，該接口由輸入表決器、差異檢測器邏輯、內(nèi)存和模塊間總線的輸出驅(qū)動器總線接口。每種方法的輸出處理器通過模塊連接器連接到三重模塊的不同通道模塊間總線。
The T8310 Processor is a fault tolerant design based on a Triple Modular Redundant (TMR) architecture operating in a lock-step configuration. Figure 1 shows, in simplified terms, the basic structure of the Trusted TMR Processor module.
The module contains three Processor fault containment regions (FCR), each containing a Motorola Power PC series Processor and its associated memory (EPROM, DRAM, Flash ROM,and NVRAM), memory mapped I/O, voter and glue logic circuits. Each Processor FCR hasvoted two-out-of-three (2oo3) read access to the other two Processor’s FCR memory systems to eliminate divergent operation.
The module’s three Processors store and execute the application program, scan and update the I/O modules and detect system faults. Each Processor executes the application program independently, but in lock-step synchronisation with the other two. Should one of the Processors diverge, additional mechanisms allow the failed Processor to re-synchronise with the other two.
Each T8310 Processor has an interface which consists of an b voter, discrepancy detector logic,
memory, and an output driver bus interface to the Inter-Module Bus. The output of each Processor is connected by the module connector to a different channel of the triplicated Inter-Module Bus.
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MOTOROLA（摩托羅拉）MVME系列
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SIEMENS（西門子老型號，停產(chǎn)備件）
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